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1-2
MLAB
SV51002
2014.01.10
Figure 1-1: LAB Structure and Interconnects Overview in Stratix V Devices
This figure shows an overview of the Stratix V LAB and MLAB structure with the LAB interconnects.
C4
C14
Row Interconnects of
Variable Speed and Length
R24
R3/R6
ALMs
Direct-Link
Interconnect from
Direct-Link
Interconnect from
Adjacent Block
Direct-Link
Interconnect to
Adjacent Block
Adjacent Block
Direct-Link
Interconnect to
Adjacent Block
Local
Interconnect
LAB
MLAB
Local Interconnect is Driven
from Either Side by Columns and LABs,
Column Interconnects of
Variable Speed and Length
and from Above by Rows
MLAB
Each MLAB supports a maximum of 640 bits of simple dual-port SRAM.
You can configure each ALM in an MLAB as either a 64 × 1 or a 32 × 2 block, resulting in a configuration
of either a 64 × 10 or a 32 × 20 simple dual-port SRAM block.
Altera Corporation
Logic Array Blocks and Adaptive Logic Modules in Stratix V Devices
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